数字电路5-2(18)

2021-02-21 11:49

正边沿 触发 VCC 8Q 8D 7D 7Q 6Q 6D 5D 5Q 时钟

20 19 18 17 16 15 14 13 12 117 4 L S 3 7 4

1 2 3 4 5 6 7 8 9 10输出 1Q 1D 2D 2Q 3Q 3D 4D 4Q GND 控制低电平 有效

八D寄存器 :三态输出 共输出控制 共时钟18


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