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备，SD 主卡和MMC 卡接口，2 通道的SPI 以及内部PLL 时钟倍频器。 S3C2410采用了ARM920T 内核， 0.18um 工艺的CMOS 标准宏单元和存储单元。它的低功耗、精简和出色的全静态设计特别适用于对成本和功耗敏感的应用。同样它还采用了一种叫做Advanced Microcontroller Bus Architecture(AMBA)新型总线结构。
S3C2410 的显著特性是它的CPU 核心， 是一个由Advanced RISC Machines(ARM) 有限公司设计的16/32 位ARM920T RISC 处理器。ARM920T 核由ARM9TDMI、存储管理单元（MMU）和高速缓存三部分组成。其中，MMU 可以管理虚拟内存。ARM920T 实现了MMU，AMBA BUS 和Harvard 高速缓冲体系结构。这一结构具有独立的16KB 指令Cache 和16KB 数据Cache，每个都是由8 字长的行构成。ARM920T 有两个内部协处理器：CP14 和CP15。CP14 用于调试控制，CP15 用于存储系统控制以及测试控制。
在时钟方面S3C2410 也有突出的特点，该芯片集成了一个具有日历功能的RTC 和具有PLL(MPLL 和UPLL)的芯片时钟发生器。MPLL 产生主时钟，能够使处理器工作频率高达203MHz。这个频率能够使处理器轻松运行Windows CE、Linux等操作系统以及进行较为复杂的处理信息。UPLL 产生实现主从USB 功能时钟。S3C2410 的内部结构图如图3-1 所示，
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图 3-1 S3C2410 内部结构图
在本系统设计过程中，我们主要用到了S3C2410A的处理器的最小系统，即时钟和电源管理、LCD控制器、A/D转换与触摸屏接口等，现对其做一介绍。
3.3 S3C2410的时钟与电源管理
时钟和电源管理模块包括三部分：时钟控制、USB控制和电源控制。
S3C24210中的时钟控制逻辑能够产生CPU所需的FCLK时钟信号、AHB 总线外围设备所需的HCLK时钟信号，以及APB总线外围设备所需的PCLK时钟信号。S3C24210有两个锁相环PLL：一个用于FCLK、HCLK和PCLK，另一个专门用于USB模块。时钟控制逻辑可以在不需要PLL的情况下慢速时钟，并且可以通过软件来控制时钟与每一个外围模块是连接还是断开，从而降低功耗。
对于电源控制逻辑，S3C24210具有多种电源管理方案，从而使每个给定的任务都具有最优的功耗。S3C24210中的电源管理模块可以激活4种模式：
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正常模式、慢速模式、空闲模式和掉电模式。其中,正常模式，即电源管理模块为CPU和S3C24210中的所有外围设备都提供时钟；慢速模式，又称无PLL模式，即不使用PLL；空闲模式，电源管理模块只断开CPU内核的时钟（FCLK），但仍为所有其他外围设备提供时钟；掉电模式，电源管理模块断开内部电源。
3.4 S3C2410的I/O口管理
为了满足不同系统设计的需求，可以很容易地通过软件对这些I/O口进行配置。每个引脚的功能必须在启动主程序之前进行定义。如果一个引脚没有复用功能，那么它可以配置为I/O。PORTA除了用作功能口，只作为输出口使用；其余的PORTB-PORTH都可以作为I\\O使用。
在S3C24210中，大部分引脚都是复用的，所以需要对每一个引脚定义其功能。为了使用I/O，首先也要定义引脚的功能。配置这些端口，是通过设置一系列寄存器来实现的。与配置I/O口相关的寄存器包括：端口控制寄存器（GPACON-CPHCON）、端口数据寄存器（GPADAT-GPHDAT）、端口上拉寄存器(GPBUP-GPHUP)、杂项控制寄存器以及外部中断寄存器(EXTINTN)等。所有GPIO寄存器的值在掉电模式下都会被保存。
端口控制寄存器用于定义每个引脚的功能。如果GPF0-GPF7和GPG0-GPG7用作掉电模式下的唤醒信号，那么这些端口必须在中断模式下配置。如果将端口配置为输出口，数据可以写入到端口数据寄存器的相应位；如果将端口配置为输入口，则可以从端口数据寄存器的相应位读出数据。端口上拉寄存器用于控制每组端口的上拉电阻为禁止还是使能。如果相应位设置为0，则表示该引脚的上拉电阻使能；为1，则表示上拉电阻禁止。如果使能了端口上拉寄存器，则不论引脚配置为那种情况，上拉电阻都会起作用。杂项控制寄存器用于控制数据端口的上拉电阻、高阻状态、USB Pad和CLKOUT的选择。24个外部中断通过不同的信号被请求。EXTINTn寄存器用于配置这些信号对于外部中断请求采用的是低电平触发、高电平触发、下降沿触发、上升沿触发还是双边沿触发。
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3.5 S3C2410的触摸屏管理
S3C24210支持触摸屏接口，它由1个触摸屏面板、4个外部晶体管、1个外部电压源、信号AIN[7]和信号AIN[5]组成，如图3-2，触摸屏接口包含
图3-2 ADC和触摸屏接口框图
1个外部晶体管控制逻辑和1个带有中断产生逻辑的ADC接口逻辑，它使用控制信号nYPON、YMON、nXPON和XMON控制并选择触摸屏面板，使用模拟信号AIN[7]和AIN[5]分别连接X方向和Y方向的外部晶体管。图3-3所示，是触摸屏与CPU连接的一个实例。XP与CPU的A[7]口相连，YP与CPU的A[5]
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图3-3 触摸屏与CPU连接电路
口相连。当S3C24210A的nYPON、YMON、nXPON和XMON输出不同的电平时，外部晶体管的导通状态如表3-1所示：
表3-1 外部晶体管的导通状态
YMON、nYPON、XMON、nXPON 结果 0110 与XP和XM相连的晶体管导通，X的位置通过A[7]输入 1001 与YP和YM相连的晶体管导通，Y的位置通过A[5]输入 触摸屏共有5种接口模式 (1)普通的A/D转换模式；
(2)X/Y位置分别转换模式，即由X位置转换模式和Y位置转换模式，其转换条件如表3-2；
(3)X/Y位置自动（顺序）转换模式。转换条件与上相同；
(4)等待中断模式，进入这种模式后，它等待触笔单击，当触笔点下后，它将产生INT_TC中断，进入这种模式的条件如表3-3；
(5)旁路模式，当进入这种模式后，A/D转换停止，ADCDAT0和ADCDAT1