淮南师范学院电气信息工程学院2013届电子信息工程专业课程设计报告 到400kHz。实验箱上的供电为3.3V，所以其接口速度最高只能达到100kHz。AT24C08与外部的I/O接口引脚连接电路如图所示。在本系统中I2CSCL、I2CSDA分别与FPGA连接。
AT24C08与外部的I/O接口引脚连接电路
2、键盘输入模块：
键盘扫描过程：在本系统中采用3×4的键盘，因此要识别按键，只需要知道是哪一行和哪一列即可，为了完成这一识别过程，我们的思想是，首先固定输出3行为高电平，然后输出4列为低电平，在读入输出的3行的值，通常高电平会被低电平拉低，如果读入的3行均为高电平，那么肯定没有按键按下，否则，如果读入的3行有一位为低电平，那么对应的该行肯定有一个按键按下，这样便可以获取到按键的行值。同理，获取列值也是如此，先输出4列为高电平，然后在输出3行为低电平，再读入列值，如果其中有哪一位为低电平，那么肯定对应的那一列有按键按下。本实验箱上的3×4矩阵键盘的电路原理如图所示。
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3×4矩阵键盘电路原理图
3、报警电路：
根据设计要求，当密码输入连续三次错误，则报警电路连通，其中报警声要求为高声2.5KHz，低声1.25KHz交替报警，交替周期为1s（1Hz时钟，需要对系统时钟进行10K分频）。
在整个试验平台的下方有两组跳线，位于左边的一组跳线用来选取喇叭的声源信号。当跳线位于左边的时候喇叭的声源来自FPGA，位于右边时声源来自AIC23模块的输入信号。位于右边的一组跳线用来控制喇叭的开关，当跳线位于左边时喇叭为开的状态，位于右边时为关的状态。要使喇叭发声请确认喇叭处于开的状态，并且声源是信号输入。扬声器（喇叭）电路图如图所示：
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扬声器电路图
4、密码锁处理单元电路
如下图为处理单元逻辑结构图由6位的拨动开关设置的数码作为6选1多路选择器的数据输入，3位二进制计数器的输出作为多路选择器的选择数据输入。多路选择器的输出与BIT开关产生的数码相比较，两者相同时输出B为1，不同时为0.。复位后，控制单元发出CLR命令使计数器清零，在控制信号的作用下，多路选择器的输入数据从低位到高位逐位被选择出来。控制单元根据处理电路反馈回来的Ｂ状态信息，获得各次比较的结果。开锁密码位数的确定由比较器完成，当输入数码的位数为8位时，比较器输出M为1，否则为0。
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处理单元逻辑结构图
5、密码锁控制模块
控制器实际上是一个有限状态机,下图为它的状态流程图。 它一共有六个状态: 准备状态 S0、密码输入状态 S1、密码设置状态 S2、确认状态 S3、开锁状态 S4和报警状态 S5。
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