全加器及其应用

实验名称：全加器及其应用

实验目的和要求：

目的: 1. 掌握数字逻辑实验箱的使用。

2. 学习全加器和代码转换电路的设计、实现以及测试。

要求: 1. 熟练掌握数字逻辑实验箱的使用。

2. 学会组合逻辑电路的设计，全加器的应用。

实验软硬件要求：四-二输入与非门 74LS00；输入或门 74LS32；输入

异或门74LS86；输入与门 74LS08，六-非门 74LS04，逻辑实验箱，电源，导线若干。

实验内容、方法和步骤 实验内容和步骤

1. 按图实6.2连线用与非门74LS00和异或门74LS86设计一位全加器。

2. 在一位全加器的基础上，设计一个二位加法器，二位加法器的框

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图如图实6.3所示。

3. 用异或门74LS86设计代码转换电路，输入是原码A3A2A1A0，输出是反码B3B2B1B0。当A3=0时，输出等于输入；当A3=1时，除B3=A3外，其余各位B2B1B0分别变成A2A1A0的反变量。 方法：

1. 组合逻辑电路的设计方法

组合逻辑电路的设计通常有四步：列真值表、化简、画逻辑图和连线。以一位全加器为例，首先要明白一位全加器的定义。一位全加器是求被加数、加数，以及来自低位进位的三个一位二进制数之和以及向高位进位的组合逻辑电路，它有三个输入端、二个输出端。 2. 卡诺图化简

一个n变量逻辑函数的卡诺图是用2n个小方块组成，每个小方块代表一个最小项，卡诺图边框外坐标中的变量是按照循环码编码，循环码编码保证了相邻的最小项中只有一位变量不同、是互补的，因此，相邻的两个最小项可以合并同时消去互补变量。

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实验结果

1. 列真值表、化简得

2. 经过列真值表、化简得

3. 经过列真值表、化简得B3= A3、B2=A2

B0=A0

A3

A3、B1=A1

A3、

小结：对全加器和代码转换电路的设计、实现以及测试有了进一步的

理解。

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