数字逻辑实验指导书
74LS90
图4-3 用74LS90接成十进制
表4-3 二-五混合进制
计数 QD 0 1 2 3 4 5 6 7 8 9 QC 3. 74LS161功能测试
按图接线，输入端接到逻辑电平开关上，时钟输入端接单次脉冲，输出接逻辑电平，按图4-4接线，完成芯片功能测试，将结果填入表4-4中。
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6 7 KK1+ 2 3 14 1 KK2+ R91 QA R92 QB R01 QC R02 CLKA QD CLKB 12 9 8 11 CH0 CH1 CH2 CH3
LED显示
输出 QB QA 数字逻辑实验指导书
图4-4 74LS161功能验证
表4-4 74LS161功能表
CLK X X X X CLR 0 1 1 1 1 1 EP X 1 0 0 X 1 请自己思考一种方法如何使用逻辑分析仪验证74LS161的计数功能，并通过时序图和状态图加以说明。
4.用2片74LS161构成六十进制计数器
用2片74LS161构成十进制计数器原理图如图4-5所示，按图连接线路，“CLR”接KK1-,“CLK”接KK2+,八个输出接逻辑电平显示，验证电路功能，观察实验现象并记录实验结果。
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74LS161
3 4 5 6 7 10 2 9 1 单 次 脉 冲
D0 Q0 D1 D2 Q1 D3 Q2 EP Q3 ET CO CLK LOAD CLR 14 13 12 11 15 LED显示
逻 辑 开 关
ET X 0 1 0 X 1 LOAD X 1 1 1 0 1 芯片功能 数字逻辑实验指导书
图 4-5 用74LS161构成六十进制
KK1- KK2+ KK1- KK2+ “0” “0” “1” 13 9 10 A B C D
A B C D
& 8 13 14 & 11 12 15 74LS161（1） 14 11 12 15 74LS161（2） CLR LOAD CLK ET EP CO Q3 D3 Q2 D2 Q1 D1 Q0 D0 3 4 5 6 CLR LOAD CLK ET EP CO Q3 D3 Q2 D2 Q1 D1 Q0 D0 & 7 10 2 9 1 3 4 5 6 7 10 2 9 1 13
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实验五 译码器和数据选择器
一、 实验目的
1．掌握74LS138型3线-8线译码器的逻辑功能 2．掌握74LS153的功能及完成8选1数据选择器的设计
二、实验设备和器材
1．TD-DS实验箱一台
2.74LS138 3线-8线译码器1片 3.74LS153 双4选1数据选择器1片 4. 74LS02 2输入端4或非门1片 5. 74LS04 六反相器1片
三 、实验内容
1.74LS138型3线-8线译码器逻辑功能的验证
按图5-1所示连接线路，输入端接逻辑开关，输出端接电平显示，根据逻辑功能表输入，将测试结果填入表5-1中。
图5-1 3线-8线译码器线路图
1 74LS138 Y0 A 2 Y1 3 B Y2 C Y3 逻辑电平开关 Y4 15 14 13 12 11 10 逻辑电平显示
4 S3 Y5 5 6 S2 Y6 9 S1 Y7 7 14
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表5-1 74LS138功能表
输 入 S1 0 X X 1 1 1 1 1 1 1 1 S2 X 1 X 0 0 0 0 0 0 0 0
2.74LS153逻辑功能测试
74LS153为双4选1数据选择器，任选其中一组，按图5-2连续，4个输入端输入不同的频率，A1、A0接逻辑开关。按表5-2输入选择信号，用逻辑分析仪观测输出波形并将结果填入表5-2中。
表5-2 74LS153功能表
S 1 0 0 0 0
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输 出 B X X 0 0 0 1 1 0 0 1 1 A X X X 0 1 0 1 0 1 0 1 Y0 Y1 Y2 Y3 Y4 Y5 Y6 Y7 S3 X X 0 0 0 0 0 0 0 0 0 C X X 0 0 0 0 0 1 1 1 1 A1 X 0 0 1 1 A0 X 0 1 0 1 Y