EDA智能时钟设计报告书 - 图文(4)

2019-02-16 14:20

的关系,设计制作的。

设计过程:

这是电路实现的最开始的设想。

闹钟比较功能:

就是一群同或门与在一起。 12/24小时转换功能:

开关打开时,对应的数据一旦出现就进行变换。

至于显示就是一个单刀双掷开关 结论:

在开关S16是高电平时,开启12/24进制转换功能;时钟12进制到了下午,灯DS6会亮,闹钟12进制到了下午,灯DS5会亮。

在开关S17是高电平时,显示时钟,低电平时显示闹钟;

在开关S18是高电平时,闹钟比较开始,此时,K2开关可以在闹钟闹铃时任意时间止闹; 在开关S19是高电平时,时钟停走,此时K3,K4,K5分别为秒,分,时调整开关; 在开关S20是高电平时,可以为闹钟设置起闹时间。 K1开关是扫描电路的清零的开关,作用未知。

实验感想:

要冷静,要淡定,想好再动手,能把模块按功能封装最好; 简化电路,尽量减少无用门电路的数量,防止延迟的干扰;

实验好难,越想越复杂,用了少量的verilog HDL语言,苦学了整整一周。但水平维持在只会用always@()来扫描输入端口。 中国电子创新,自必从EDA始。 以上。


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