停车场电子车位计数器
7 主要元器件介绍
7.1 可逆计数器 74LS192
计数开始时，先在RD 端输入一个正脉冲，此时两个计数器均被置为 0 状态。此后在LD端输入“1”，RD 端输入“0”，则计数器处于计数状态。
在个位的74LS192(1)的CU 端逐个输入计数脉冲CP，个位的74LS192开始进行加法计数。在第10个CP脉冲上升沿到来后，个位74LS192的状态从1001→0000，同时其进位输出从0→1。此上升沿使十位的74LS192(2)从0000开始计数，直到第100个CP脉冲作用后，计数器由1001 1001恢复为0000 0000，完成一次计数循环。当第一级计数器的CPU端接收到脉冲信号时，计数器进行加法计数；当计数器的CPD端接收到脉冲信号时，计数器进行减法计数和加法计数。第一级计数为9时下一个脉冲到来时，第一级计数器加1进位变零，向上一级进位；减法计数时，当第一级计数器为0时，下一个脉冲到来时，上一级计数器借位，第一级从10减1变为9，
7.1.1 引脚图
图 7.1 （a）引脚图和(b)逻辑符号
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7.1.2 功能表
表 7.1 74LS192功能表
输入 MR 输出 P3 P2 P1 P0 Q3 Q2 Q1 Q0 1 × × × × × × × 0 0 0 0 0 0 0 1 0 1
7.1.3 功能介绍
74LS192同步十进制可逆计数器具有双时钟输入，可以执行十进制加法
× 1 × d c b a d c b a 1 × × × × × × × × 加计数 减计数 和减法计数并具有清除、置数等功能。当清除端CR=1时，计数器直接清零（称为异步清零）。执行其它功能时，CR=0。当CR=LD=0时，数据直接从输入端DA、DB、DC、DD置入计数器；当CR=0、LD=1时，执行计数功能。当CPD=1时，计数脉冲由加计数端CPD输入，在计数脉冲上升沿按8421编码执行十进制加法计数。当CPU=1时，计数脉冲由减法计数端CPD输入，在计数脉冲上升沿按8421编码执行十进制减法计数。
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真值表： MR H L L L L
PL X L H H H CPU X X H ↑ H CPD X X H H ↑ MODE工作模式 Reset (Asyn.)清除 Preset (Asyn.)预置 No Change保持 Count Up加计数 Count DowN 减计数
7.2 74LS38译码器
引脚介绍：
引出端符号
A0→A3 译码地址输入端
BI/RBO 消隐输入（低电平有效）/脉冲消隐输出（低电平有效） LT 灯测试输入端（低电平有效） RBI 脉冲消隐输入端（低电平有效） Ya→Yg 段输出
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7.3 555集成定时器
7.3.1 引脚图
7.3.2基本原理
各引脚的功能
1脚：外接电源负端VSS或接地，一般情况下接地。 2脚：TL低触发端 3脚：输出端Vo
4脚：RD是直接清零端。当RD端接低电平，则时基电路不工作，此时不论
TL、TH处于何电平，时基电路输出为“0”，该端不用时应接高电平。
5脚：VC为控制电压端。若此端外接电压，则可改变内部两个比较器的基准电压，当该端不用时，应将该端串入一只0.01μF电容接地，以防引入干扰。
6脚：TH高触发端
7脚：放电端。该端与放电管集电极相连，用做定时器时电容的放电。 8脚：外接电源VCC，双极型时基电路VCC的范围是4.5 ~ 16V，CMOS型时基
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电路VCC的范围为3 ~ 18V。一般用5V。
555定时器的内部电路由分压器，电压比较器C1和C2，简单SR锁存器，放电三极管T以及缓冲器G组成。三个5千欧的电阻串联组成分压器，为比较器C1C2提供参考电压。当控制电压端（5）悬空时，比较器C1C2的基准电压分别为2Vcc/3和Vcc/3。
管脚6为C1的信号输入端，称为阈值输入端；关脚2是比较器C2的信号输入端，称为触发输入端。如果控制电路电压端（5）外接电压v,则比较器电压C1 C2的基准电压就变为v和v/2。比较器C1 C2的输出控制SR锁存器和放电三极管T的状态。
放电三极管T为外接电路提供放电通路，在使用定时器时，该三极管的集电极（7脚）一般都要飞、外接上拉电阻。
4管脚为直接复位输入端，当其为低电平时，不管其他输入端的状态如何，输出端即为低电平。
当vi1大于2Vcc/3，vi2大于Vcc/3时，比较器C1输出低电平，比较器C2输出高电平，简单SR锁存器Q端置0，放电三极管T导通，输出端为低电平。
当vi1小于2 Vcc /3，vi2小于Vcc/3时，比较器C1输出高电平，C2输出低电平，简单SR锁存器置1，放电三极管截止，输出端为高电平。
当vi1小于2 Vcc /3，vi2大于Vcc/3时，简单SR锁存器R=1,S=1锁存器状态不变，电路保持原状态不变。
7.3.3功能表 输入 15
输出