（13） 在图1.16中完成所有管脚的分配，并把没有用到的引
脚设置为As input tri-stated,
Assignments—Device—Device and Pin Options –Unused Pins，然后重新编译项目；
（14） 对目标版适配下载，（此处认为实验板已安装妥当，有
关安装方法见实验板详细说明）单击如图1.17所示；
按钮，屏幕显示
图1.18 适配下载界面
（15） 选择Hardware Setup ，如图1.19所示；
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图1.19 下载硬件设置
（16） 在图1.19中选择添加硬件ByteBlasteMV or ByteBlaster II，如图1.20所示；
图1.20 添加下载硬件
（17） 可以根据需要添加多种硬件于硬件列表中，双击可选列表中需要的一种，使其出现在当前选择硬件栏中（本实验板采用ByteBlaster II 下载硬件），如图1.21所示；
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图1.21 选择当前下载硬件
（18） 选择下载模式，本实验板可采用两种配置方式，AS模式对配置芯片下载，可以掉电保持，而JTGA模式对FPGA下载，掉电后FPGA信息丢失，每次上电都需要重新配置，如图1.22所示；
图1.22 选择下载模式
（19） 选择下载文件和器件，JTAG 模式使用后缀为sof 的文
件，AS模式使用后缀为pof的文件，选择需要进行的操作，分别如图1.23，图1.24所示；使用AS模式时，还
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要设置Assignments 菜单下Device，如图1.25，选择图1.25中Device & Pin Options，如图1.26，选择使用的配置芯片，编译；
图1.23 JTAG下载模式
图1.24 AS下载模式
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图1.25 器件选项
图1.25 配置芯片选择
（20） 点击Start按键，开始下载。 1.3 文本编辑 （verilog）
这一节中将向读者简单介绍如何使用Quartus II软件进行文本编辑。
文本编辑（verilog）的操作如下： （1） 建立我们的project2项目如下图：
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