基于FPGA的数字频率计实验报告(能测占空比) - 图文(5)

2019-08-31 17:35

variable counter4 :integer range 0 to 3:=0; begin

if(freq12k'event and freq12k='1') then counter4:=counter4+1; case counter4 is

when 0 => wei <= \ when 1 => wei <= \ when 2 => wei <= \ when 3 => wei <= \ when others => null; end case; end if;

end process p4;

end architecture abc;

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