FPGA实验指导书
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实验内容
1、启动Xilinx ISE建立一个空白工程，然后命名。
2、新建VHDL源程序文件并命名，输入程序代码并保存，进行综合编译，若在编译过程中发现错误，则找出并更正错误，直至编译成功为止。打印源程序。 3、利用RTL Viewer工具，生成查看RTL图。打印RTL图。
4、新建仿真波形文件，选择FPGA器件型号，分配FPGA引脚。对各模块设计进行功能仿真与时序仿真，验证设计结果。打印波形文件。打印功能仿真与时序仿真结果。
5、对该工程文件进行全程编译处理，若在编译过程中发现错误，则找出并更正错误，直至编译成功为止。 6、利用Digilent Adept 编程调试工具，下载至AnvylTM系统，调试成功。照片记录调试结果。
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