图1－17 中断响应周期时序
说明：
①要求INTR信号是一个高电平信号，并且维持两个T，因为CPU在一条指令的最入中断响应后，它在第一个周期的 ②在最小模式下，中断应答信号 是通过
、
、
仍需采样INTR。
来自8086的引脚，而在最大模式时，则
的组合由总线控制器产生。
③第一个总线周期通过 用来通知外设，CPU准备响应中断，第二个总线周期
中断类型码，该类型码通过数据总线的低8位传送，来自中断源。CPU据此转入中④在中断响应期间，
为低，数据/地址线浮空，
数据/状态线浮空
在两个中断响应周期之间可安排2～3个空闲周期（8086）或没有（8088）。 (4). 系统的复位和启动操作（对最大小模式都一样）
8086/8088的复位和启动操作，是通过RESET引脚上的触发信号来执行的，当RESCPU就结束当前操作，进入初始化（复位）过
程，包括把各内部寄存器（除CS）清0，标志寄存器清0，指令队列清0，将FFF电路，经过7个T状态，CPU即自动启动。
系统从FFFF0H开始执行指令。重新启动的动作是当RESET从高到低跳变时触发CP
要注意的是，由于在复位操作时，标志寄存器被清0，因此其中的中断标志IF也
所有的可屏蔽中断请求，都不能响应，即复位以后，若需要必需用开中断指令来重
复位操作的时序图如图1－18所示(P22)，表1－8给出了复位后寄存器的状态。
图1－18 系统复位时序 表1-8 复位后寄存器的状态 寄存器 DS 状态 寄存器 状态 0000H 0000H 寄存器 CS ES 状态 0FFFFH 0000H F（PSW） 0000H IP 0000H SS IF 指令队列 空 0（禁止） (5). 总线占用周期 当系统中有其它总线主设备有总线请求时，向CPU发总线请求信号HOLD， HOLD信号可以与时钟信号异步，则在下一个时钟的上升沿同步HOLD信号。 CPU收到HOLD信号后，在当前总线周期的T4或下一个总线周期的T1的后沿， 输出保持响应信号HLDA，从下一个时钟周期开始CPU出让总线控制权，进入总线束，掌握总线控制权的总线主设备使HOLD信号 变低，并在接着的下降沿使HLDA信号变为无效，系统退出总线占用周期。 (6). 总线空操作 前面我们曾讲过，只有在CPU与存贮器或I/O端口之间传送数据时，CPU才执行它们之间不传送数据时，则进入总线空闲周期，而总线空闲周期即对应总线空操作在总线空闲周期内，CPU的各种信号线上的状态维持不变。要注意的是， 总线空操作并不意味着CPU不工作，只是总线接口部件BIU不工作，而总线 执行部件EU仍在工作，如进行计算、译码、传送数据等。实质上总线空操作期间等待。 3．最大模式下的典型时序 (1). 最大模式下的总线读周期
时序图如图1－20 所示(P23)，与最小模式下的读周期相比，不同的就是读 信号考虑加入总线控制器后，它可以由
，这两个信号与原
、
、
状态信号来产生
和
相比，不仅明确指出了操作对象，而且信号的交流
，若用
特性也好，所以我们下面就考虑用它们不用 式与最小模式相同。
信号的话，则最大模
图1－20 最大模式存储器读周期时序
? 状态
是由总线控制器发出的。
基本同最小模式，不同的是ALE、 ?
状态
变成
或
不同的是此时 ?
状态
，送到存贮器或I/O端口。
数据已读出送上数据总线，这时 、 、 ＝111进入无源状态。 。
若数据没能及时读出，则同最小模式一样自动插入
? 状态
、
、
数据消失，状态信号进入高阻， (2). 最大模式下的总线写周期
根据下一个总线周期的类型进行变
时序图如图1－21 所示(P23)，与上述最大模式下的总线读周期相比，就是
和 和
成为
和
，另外还有一组
（
或 ）或
（比 （
提前一个T有效），这时
。
取代最小模式下的
图1－21 最大模式存储器写周期时序
? 状态
同读周期。 ?
状态 或
?
状态 或
?
状态
有效，比
等慢一个T，
、
、
有效，要写入的数据送上DB，
有效。
进入无源状态。若需
等被撤消， 、 、 根据下一总线周期的性质变化， 失效，从
工作，其它引脚高阻。 (3). I/O读/写周期
I/O读写周期的时序如图1-22 所示(P24)，与存储器读/写周期的时序基本 相同。不同之处在于：
①一般I/O接口的工作速度较慢，因而需插入等待周期Tw。 ②T1期间只发出16位地址信号，A19~16为0。 ③8288发出的读/写命令为
/
。
图1－22 最大模式I/O读写周期时序
习题与思考：
1． 什么是指令周期？什么是总线周期？什么是时钟周期？它们之间的关系如何？ 2． 什么是时序？为什么要讨论时序？
3． 8086/8088 CPU读/写总线周期各包含多少个时钟周期？什么情况下需要插入Tw周期？应么因素？
4． 试简述8086/8088系统最小模式时从储存器读数据时的时序过程。
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